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// +build sam,atsamd21,atsamd21g18
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package runtime
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import (
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"device/sam"
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)
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func initSERCOMClocks() {
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// Turn on clock to SERCOM0 for UART0
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sam.PM.APBCMASK |= sam.PM_APBCMASK_SERCOM0_
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// Use GCLK0 for SERCOM0 aka UART0
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// GCLK_CLKCTRL_ID( clockId ) | // Generic Clock 0 (SERCOMx)
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// GCLK_CLKCTRL_GEN_GCLK0 | // Generic Clock Generator 0 is source
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// GCLK_CLKCTRL_CLKEN ;
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sam.GCLK.CLKCTRL = sam.RegValue16((sam.GCLK_CLKCTRL_ID_SERCOM0_CORE << sam.GCLK_CLKCTRL_ID_Pos) |
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(sam.GCLK_CLKCTRL_GEN_GCLK0 << sam.GCLK_CLKCTRL_GEN_Pos) |
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sam.GCLK_CLKCTRL_CLKEN)
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waitForSync()
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// Turn on clock to SERCOM1
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sam.PM.APBCMASK |= sam.PM_APBCMASK_SERCOM1_
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sam.GCLK.CLKCTRL = sam.RegValue16((sam.GCLK_CLKCTRL_ID_SERCOM1_CORE << sam.GCLK_CLKCTRL_ID_Pos) |
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(sam.GCLK_CLKCTRL_GEN_GCLK0 << sam.GCLK_CLKCTRL_GEN_Pos) |
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sam.GCLK_CLKCTRL_CLKEN)
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waitForSync()
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// Turn on clock to SERCOM2
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sam.PM.APBCMASK |= sam.PM_APBCMASK_SERCOM2_
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sam.GCLK.CLKCTRL = sam.RegValue16((sam.GCLK_CLKCTRL_ID_SERCOM2_CORE << sam.GCLK_CLKCTRL_ID_Pos) |
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(sam.GCLK_CLKCTRL_GEN_GCLK0 << sam.GCLK_CLKCTRL_GEN_Pos) |
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sam.GCLK_CLKCTRL_CLKEN)
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waitForSync()
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// Turn on clock to SERCOM3
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sam.PM.APBCMASK |= sam.PM_APBCMASK_SERCOM3_
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sam.GCLK.CLKCTRL = sam.RegValue16((sam.GCLK_CLKCTRL_ID_SERCOM3_CORE << sam.GCLK_CLKCTRL_ID_Pos) |
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(sam.GCLK_CLKCTRL_GEN_GCLK0 << sam.GCLK_CLKCTRL_GEN_Pos) |
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sam.GCLK_CLKCTRL_CLKEN)
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waitForSync()
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// Turn on clock to SERCOM4
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sam.PM.APBCMASK |= sam.PM_APBCMASK_SERCOM4_
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// Use GCLK0 for SERCOM4
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sam.GCLK.CLKCTRL = sam.RegValue16((sam.GCLK_CLKCTRL_ID_SERCOM4_CORE << sam.GCLK_CLKCTRL_ID_Pos) |
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(sam.GCLK_CLKCTRL_GEN_GCLK0 << sam.GCLK_CLKCTRL_GEN_Pos) |
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sam.GCLK_CLKCTRL_CLKEN)
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waitForSync()
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// Turn on clock to SERCOM5
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sam.PM.APBCMASK |= sam.PM_APBCMASK_SERCOM5_
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// Use GCLK0 for SERCOM5
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sam.GCLK.CLKCTRL = sam.RegValue16((sam.GCLK_CLKCTRL_ID_SERCOM5_CORE << sam.GCLK_CLKCTRL_ID_Pos) |
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(sam.GCLK_CLKCTRL_GEN_GCLK0 << sam.GCLK_CLKCTRL_GEN_Pos) |
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sam.GCLK_CLKCTRL_CLKEN)
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waitForSync()
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}
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